Perform cleanup and file shrinkage of the AMD AGESA code.

Signed-off-by: Frank.Vibrans <frank.vibrans@amd.com>
Acked-by: Marc Jones <marcj303@gmail.com>



git-svn-id: svn://svn.coreboot.org/coreboot/trunk@6452 2b7e53f0-3cfb-0310-b3e9-8179ed1497e1

10 files changed, 25 insertions, 4426 deletions

diff --git a/src/vendorcode/amd/agesa/Proc/CPU/Family/0x14/F14MicrocodePatch0500000B_Unenc.c b/src/vendorcode/amd/agesa/Proc/CPU/Family/0x14/F14MicrocodePatch0500000B_Unenc.c
deleted file mode 100644
index 463477f03c..0000000000
--- a/src/vendorcode/amd/agesa/Proc/CPU/Family/0x14/F14MicrocodePatch0500000B_Unenc.c
+++ /dev/null
@@ -1,1461 +0,0 @@
-/* $NoKeywords:$ */
-/**
- * @file
- *
- * AMD Family_14 Microcode patch.
- *
- * Fam14 Microcode Patch rev 0500000B for 5800 or equivalent.
- *
- * @xrefitem bom "File Content Label" "Release Content"
- * @e project:      AGESA
- * @e sub-project:  CPU/FAMILY/0x14
- * @e \$Revision: 34897 $   @e \$Date: 2010-07-14 10:07:10 +0800 (Wed, 14 Jul 2010) $
- *
- */
-/*
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- */
-/*----------------------------------------------------------------------------------------
- *                             M O D U L E S    U S E D
- *----------------------------------------------------------------------------------------
- */
-#include "AGESA.h"
-#include "cpuRegisters.h"
-#include "cpuEarlyInit.h"
-
-/*----------------------------------------------------------------------------------------
- *                   D E F I N I T I O N S    A N D    M A C R O S
- *----------------------------------------------------------------------------------------
- */
-
-/*----------------------------------------------------------------------------------------
- *                  T Y P E D E F S     A N D     S T R U C T U R E S
- *----------------------------------------------------------------------------------------
- */
-
-// Patch code 0500000B for 5800 and equivalent
-CONST MICROCODE_PATCHES ROMDATA CpuF14MicrocodePatch0500000B_Unenc =
-{
-0x10,
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-0x00,
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-0xaa,
-0xaa,
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-};
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- *           P R O T O T Y P E S     O F     L O C A L     F U N C T I O N S
- *----------------------------------------------------------------------------------------
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-
-/*----------------------------------------------------------------------------------------
- *                          E X P O R T E D    F U N C T I O N S
- *----------------------------------------------------------------------------------------
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diff --git a/src/vendorcode/amd/agesa/Proc/CPU/Family/0x14/F14MicrocodePatch0500001A_Unenc.c b/src/vendorcode/amd/agesa/Proc/CPU/Family/0x14/F14MicrocodePatch0500001A_Unenc.c
deleted file mode 100644
index 8aafa801a9..0000000000
--- a/src/vendorcode/amd/agesa/Proc/CPU/Family/0x14/F14MicrocodePatch0500001A_Unenc.c
+++ /dev/null
@@ -1,1461 +0,0 @@
-/* $NoKeywords:$ */
-/**
- * @file
- *
- * AMD Family_14 Microcode patch.
- *
- * Fam14 Microcode Patch rev 0500001A for 5801 or equivalent.
- *
- * @xrefitem bom "File Content Label" "Release Content"
- * @e project:      AGESA
- * @e sub-project:  CPU/FAMILY/0x14
- * @e \$Revision: 37850 $   @e \$Date: 2010-09-13 18:09:57 -0400 (Mon, 13 Sep 2010) $
- *
- */
-/*
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- * LOSS OF USE, DATA, OR PROFITS; OR BUSINESS INTERRUPTION) HOWEVER CAUSED AND
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- * (INCLUDING NEGLIGENCE OR OTHERWISE) ARISING IN ANY WAY OUT OF THE USE OF THIS
- * SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
- * 
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- *
- */
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- *                             M O D U L E S    U S E D
- *----------------------------------------------------------------------------------------
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-#include "AGESA.h"
-#include "cpuRegisters.h"
-#include "cpuEarlyInit.h"
-
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- *                   D E F I N I T I O N S    A N D    M A C R O S
- *----------------------------------------------------------------------------------------
- */
-
-/*----------------------------------------------------------------------------------------
- *                  T Y P E D E F S     A N D     S T R U C T U R E S
- *----------------------------------------------------------------------------------------
- */
-
-// Patch code 0500001A for 5801 and equivalent
-CONST MICROCODE_PATCHES ROMDATA CpuF14MicrocodePatch0500001A_Unenc =
-{
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-0xeb,
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-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0x81,
-0x7f,
-0x00,
-0xe1,
-0x1f,
-0xc0,
-0xbf,
-0xff,
-0xbf,
-0x07,
-0x00
-};
-
-/*----------------------------------------------------------------------------------------
- *           P R O T O T Y P E S     O F     L O C A L     F U N C T I O N S
- *----------------------------------------------------------------------------------------
- */
-
-/*----------------------------------------------------------------------------------------
- *                          E X P O R T E D    F U N C T I O N S
- *----------------------------------------------------------------------------------------
- */
diff --git a/src/vendorcode/amd/agesa/Proc/GNB/Gfx/Family/0x14/F14GfxServices.c b/src/vendorcode/amd/agesa/Proc/GNB/Gfx/Family/0x14/F14GfxServices.c
index 6b072b4d4d..139d47cb5a 100644
--- a/src/vendorcode/amd/agesa/Proc/GNB/Gfx/Family/0x14/F14GfxServices.c
+++ b/src/vendorcode/amd/agesa/Proc/GNB/Gfx/Family/0x14/F14GfxServices.c
@@ -483,10 +483,10 @@ REGISTER_COPY_ENTRY CnbToGncRegisterCopyTable [] = {
     GMMx284C_Dimm0AddrMap_WIDTH + GMMx284C_Dimm1AddrMap_WIDTH
   },
   {
-    MAKE_SBDFO (0, 0, 0x18, 2, D18F2x94_ADDRESS),
+    MAKE_SBDFO (0, 0, 0x18, 2, D18F2x094_ADDRESS),
     GMMx284C_ADDRESS,
-    D18F2x94_BankSwizzleMode_OFFSET,
-    D18F2x94_BankSwizzleMode_WIDTH,
+    D18F2x094_BankSwizzleMode_OFFSET,
+    D18F2x094_BankSwizzleMode_WIDTH,
     GMMx284C_BankSwizzleMode_OFFSET,
     GMMx284C_BankSwizzleMode_WIDTH
   },
diff --git a/src/vendorcode/amd/agesa/Proc/GNB/Gfx/GfxStrapsInit.c b/src/vendorcode/amd/agesa/Proc/GNB/Gfx/GfxStrapsInit.c
index 0b3791934c..350e9b6bf5 100644
--- a/src/vendorcode/amd/agesa/Proc/GNB/Gfx/GfxStrapsInit.c
+++ b/src/vendorcode/amd/agesa/Proc/GNB/Gfx/GfxStrapsInit.c
@@ -167,11 +167,9 @@ GfxStrapsInit (
   if (Gfx->GfxControllerMode == GfxControllerLegacyBridgeMode) {
     D0F0x64_x1D.Field.IntGfxAsPcieEn = 0x0;
     D0F0x64_x1C.Field.RcieEn = 0x0;
-    D0F0x64_x1C.Field.PcieDis = 0x1;
   } else {
     D0F0x64_x1D.Field.IntGfxAsPcieEn = 0x1;
     D0F0x64_x1C.Field.RcieEn = 0x1;
-    D0F0x64_x1C.Field.PcieDis = 0x0;
     //LN/ON A0 (MSI)
     GnbLibPciRMW (MAKE_SBDFO (0, 0, 1, 0, 0x4), AccessS3SaveWidth32, 0xffffffff, BIT2, GnbLibGetHeader (Gfx));
   }
@@ -182,7 +180,6 @@ GfxStrapsInit (
   }
   D0F0x64_x1C.Field.AudioEn = Gfx->GnbHdAudio;
   D0F0x64_x1C.Field.F0En = 0x1;
-//  D0F0x64_x1C.Field.F0BarEn = 0x1;  //Keep re-sizable bar disabled at 0 due to silicon bug
   D0F0x64_x1C.Field.RegApSize = 0x1;
 
   if (Gfx->UmaInfo.UmaSize > 128 * 0x100000) {
@@ -315,10 +312,4 @@ GfxSetIdleVoltageMode (
   IN      GFX_PLATFORM_CONFIG   *Gfx
   )
 {
-  FCRxFF30_0191_STRUCT   FCRxFF30_0191;
-  NbSmuSrbmRegisterRead (FCRxFF30_0191_ADDRESS, &FCRxFF30_0191.Value, GnbLibGetHeader (Gfx));
-  FCRxFF30_0191.Field.GfxIdleVoltChgEn = 0x1;
-  FCRxFF30_0191.Field.GfxIdleVoltChgMode = (Gfx->GfxFusedOff || Gfx->UmaInfo.UmaMode != UMA_NONE) ? 0x0 : 0x1;
-  NbSmuSrbmRegisterWrite (FCRxFF30_0191_ADDRESS, &FCRxFF30_0191.Value, TRUE, GnbLibGetHeader (Gfx));
-
 }
diff --git a/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbNbInitLibV1/GnbNbInitLibV1.c b/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbNbInitLibV1/GnbNbInitLibV1.c
index f2ba2cf0da..468e57f74c 100644
--- a/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbNbInitLibV1/GnbNbInitLibV1.c
+++ b/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbNbInitLibV1/GnbNbInitLibV1.c
@@ -158,10 +158,10 @@ GnbLpcDmaDeadlockPrevention (
   // For GPP Link core, enable special NP memory write protocol on the  processor side PCIE controller
   GnbLibPciIndirectRMW (
     NbPciAddress.AddressValue | D0F0xE0_ADDRESS,
-    CORE_SPACE (1, D0F0xE4_CORE_0010_ADDRESS),
+    CORE_SPACE (1, 0x10),
     AccessWidth32,
     0xFFFFFFFF,
-    1 << D0F0xE4_CORE_0010_UmiNpMemWrite_OFFSET,
+    1 << 9,
     StdHeader
   );
 
@@ -244,4 +244,4 @@ GnbLock (
     TRUE,
     StdHeader
     );
-}
\ No newline at end of file
+}
diff --git a/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PciePortServices.c b/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PciePortServices.c
index 31d5f5a0db..b2c490f122 100644
--- a/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PciePortServices.c
+++ b/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PciePortServices.c
@@ -144,9 +144,9 @@ PcieLinkInitHotplug (
       );
     PcieRegisterWriteField (
       PcieEngineGetParentWrapper (Engine),
-      CORE_SPACE (Engine->Type.Port.CoreId, D0F0xE4_CORE_0010_ADDRESS),
-      D0F0xE4_CORE_0010_LcHotPlugDelSel_OFFSET,
-      D0F0xE4_CORE_0010_LcHotPlugDelSel_WIDTH,
+      CORE_SPACE (Engine->Type.Port.CoreId, 0x10),
+      1,
+      3,
       0x5,
       TRUE,
       Pcie
diff --git a/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PcieTopologyServices.c b/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PcieTopologyServices.c
index e45ecc67a1..2bddde40f1 100644
--- a/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PcieTopologyServices.c
+++ b/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PcieTopologyServices.c
@@ -525,29 +525,22 @@ PcieTopologyInitSrbmReset (
   IN      PCIe_PLATFORM_CONFIG  *Pcie
   )
 {
-  D0F0xE4_WRAP_8063_STRUCT  D0F0xE4_WRAP_8063;
-  D0F0xE4_WRAP_8063.Value = PcieRegisterRead (
+  UINT32 pcireg;
+  UINT32 regmask = 0x7030;;
+  pcireg = PcieRegisterRead (
                                Wrapper,
-                               WRAP_SPACE (Wrapper->WrapId, D0F0xE4_WRAP_8063_ADDRESS),
+                               WRAP_SPACE (Wrapper->WrapId, 0x8063),
                                Pcie
                                );
   if (SrbmResetEnable) {
-    D0F0xE4_WRAP_8063.Field.ResetSrbm0En = 0x1;
-    D0F0xE4_WRAP_8063.Field.ResetSrbm1En = 0x1;
-    D0F0xE4_WRAP_8063.Field.ResetSrbmNbEn = 0x1;
-    D0F0xE4_WRAP_8063.Field.ResetSrbmGfxEn = 0x1;
-    D0F0xE4_WRAP_8063.Field.ResetSrbmDcEn = 0x1;
+	pcireg |= regmask;
   } else {
-    D0F0xE4_WRAP_8063.Field.ResetSrbm0En = 0x0;
-    D0F0xE4_WRAP_8063.Field.ResetSrbm1En = 0x0;
-    D0F0xE4_WRAP_8063.Field.ResetSrbmNbEn = 0x0;
-    D0F0xE4_WRAP_8063.Field.ResetSrbmGfxEn = 0x0;
-    D0F0xE4_WRAP_8063.Field.ResetSrbmDcEn = 0x0;
+	pcireg &= ~(regmask);
   }
   PcieRegisterWrite (
     Wrapper,
-    WRAP_SPACE (Wrapper->WrapId, D0F0xE4_WRAP_8063_ADDRESS),
-    D0F0xE4_WRAP_8063.Value,
+    WRAP_SPACE (Wrapper->WrapId, 0x8063),
+    pcireg,
     FALSE,
     Pcie
     );
diff --git a/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PcieUtilityLib.c b/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PcieUtilityLib.c
index 5a288a429c..ef868203dd 100644
--- a/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PcieUtilityLib.c
+++ b/src/vendorcode/amd/agesa/Proc/GNB/Modules/GnbPcieInitLibV1/PcieUtilityLib.c
@@ -424,9 +424,9 @@ PcieLockRegisters (
     for (CoreId = Wrapper->StartPcieCoreId; CoreId <= Wrapper->EndPcieCoreId; CoreId++) {
       PcieRegisterWriteField (
         Wrapper,
-        CORE_SPACE (CoreId, D0F0xE4_CORE_0010_ADDRESS),
-        D0F0xE4_CORE_0010_HwInitWrLock_OFFSET,
-        D0F0xE4_CORE_0010_HwInitWrLock_WIDTH,
+        CORE_SPACE (CoreId, 0x10),
+        0,
+        1,
         0x1,
         TRUE,
         Pcie
diff --git a/src/vendorcode/amd/agesa/Proc/GNB/PCIe/PcieInit.c b/src/vendorcode/amd/agesa/Proc/GNB/PCIe/PcieInit.c
index 08588fdcda..8b49ad8973 100644
--- a/src/vendorcode/amd/agesa/Proc/GNB/PCIe/PcieInit.c
+++ b/src/vendorcode/amd/agesa/Proc/GNB/PCIe/PcieInit.c
@@ -112,14 +112,13 @@ PciePortsVisibilityControl (
 PCIE_HOST_REGISTER_ENTRY CoreInitTable [] = {
   {
     D0F0xE4_CORE_0020_ADDRESS,
-    D0F0xE4_CORE_0020_CiRcOrderingDis_MASK |
-    D0F0xE4_CORE_0020_CiSlvOrderingDis_MASK,
+    D0F0xE4_CORE_0020_CiRcOrderingDis_MASK,
     (0x1 << D0F0xE4_CORE_0020_CiRcOrderingDis_OFFSET)
   },
   {
-    D0F0xE4_CORE_0010_ADDRESS,
-    D0F0xE4_CORE_0010_RxUmiAdjPayloadSize_MASK,
-    (0x4 << D0F0xE4_CORE_0010_RxUmiAdjPayloadSize_OFFSET)
+    0x10,
+    0x1c00,
+    (0x4 << 10)
   },
   {
     D0F0xE4_CORE_001C_ADDRESS,
@@ -149,8 +148,7 @@ PCIE_HOST_REGISTER_ENTRY CoreInitTable [] = {
   },
   {
     D0F0xE4_CORE_00B0_ADDRESS,
-    D0F0xE4_CORE_00B0_StrapF0MsiEn_MASK |
-    D0F0xE4_CORE_00B0_StrapF0AerEn_MASK,
+    D0F0xE4_CORE_00B0_StrapF0MsiEn_MASK, 
     (0x1 << D0F0xE4_CORE_00B0_StrapF0MsiEn_OFFSET)
   }
 };