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| -rw-r--r-- | src/mainboard/google/gru/sdram_inf/sdram-lpddr3-hynix-4GB-928.inc (renamed from src/mainboard/google/gru/sdram_inf/gru-sdram-lpddr3-hynix-4GB.inc) | 14 |
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diff --git a/src/mainboard/google/gru/sdram_configs.c b/src/mainboard/google/gru/sdram_configs.c index 8674590300..92e00efdba 100644 --- a/src/mainboard/google/gru/sdram_configs.c +++ b/src/mainboard/google/gru/sdram_configs.c @@ -22,21 +22,35 @@ #include <types.h> static struct rk3399_sdram_params sdram_configs[] = { -#if IS_ENABLED(CONFIG_BOARD_GOOGLE_GRU) -#include "sdram_inf/gru-sdram-lpddr3-hynix-4GB.inc" -#elif IS_ENABLED(CONFIG_BOARD_GOOGLE_KEVIN) +#include "sdram_inf/sdram-lpddr3-hynix-4GB-200.inc" +/* THIS IS FOR KEVIN ONLY! crosbug.com/p/54144 */ #include "sdram_inf/kevin-sdram-lpddr3-hynix-4GB.inc" -#else -#error "What is your board name?" -#endif +#include "sdram_inf/sdram-lpddr3-hynix-4GB-666.inc" +#include "sdram_inf/sdram-lpddr3-hynix-4GB-800.inc" +/* #include "sdram_inf/sdram-lpddr3-hynix-4GB-928.inc" */ +}; + +enum dram_speeds { + dram_200MHz = 0, + dram_300MHz = 1, + dram_666MHz = 2, + dram_800MHz = 3, +/* dram_928MHz = 4, */ }; const struct rk3399_sdram_params *get_sdram_config() { - u32 ramcode = ram_code(); + enum dram_speeds speed; + + if (IS_ENABLED(CONFIG_BOARD_GOOGLE_KEVIN)) + speed = dram_300MHz; + else if (IS_ENABLED(CONFIG_BOARD_GOOGLE_GRU)) + speed = dram_800MHz; + else + speed = dram_200MHz; + + printk(BIOS_INFO, "Using SDRAM configuration for %d MHz\n", + sdram_configs[speed].ddr_freq / (1000 * 1000)); - if (ramcode >= ARRAY_SIZE(sdram_configs) - || sdram_configs[ramcode].dramtype == UNUSED) - die("Invalid RAMCODE."); - return &sdram_configs[ramcode]; + return &sdram_configs[speed]; } diff --git a/src/mainboard/google/gru/sdram_inf/sdram-lpddr3-hynix-4GB-200.inc b/src/mainboard/google/gru/sdram_inf/sdram-lpddr3-hynix-4GB-200.inc new file mode 100644 index 0000000000..253364097d --- /dev/null +++ b/src/mainboard/google/gru/sdram_inf/sdram-lpddr3-hynix-4GB-200.inc @@ -0,0 +1,1563 @@ +/* + * This file is part of the coreboot project. + * + * This program is free software; you can redistribute it and/or modify + * it under the terms of the GNU General Public License as published by + * the Free Software Foundation; version 2 of the License. + * + * This program is distributed in the hope that it will be useful, + * but WITHOUT ANY WARRANTY; without even the implied warranty of + * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the + * GNU General Public License for more details. + */ + +{ + { + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x0e080807}, + {0x05010605}, + {0x00000002}, + {0x00006076}, + {0x00000054}, + 0x00000000 + } + }, + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x0e080807}, + {0x05010605}, + {0x00000002}, + {0x00006076}, + {0x00000054}, + 0x00000000 + } + } + }, + .ddr_freq = 200*MHz, + .dramtype = LPDDR3, + .num_channels = 2, + .stride = 13, + .odt = 1, + { + { + 0x00000700, /* DENALI_CTL_00_DATA */ + 0x00000000, /* DENALI_CTL_01_DATA */ + 0x00000000, /* DENALI_CTL_02_DATA */ + 0x00000000, /* DENALI_CTL_03_DATA */ + 0x00000000, /* DENALI_CTL_04_DATA */ + 0x00000014, /* DENALI_CTL_05_DATA */ + 0x00009c40, /* DENALI_CTL_06_DATA */ + 0x000000c8, /* DENALI_CTL_07_DATA */ + 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