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/* Display controller SS */
/* DC part1 */
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/* Audio */
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/* DC part2 */
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/* CM40 */
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/* VPU clocks. */
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/* MIPI-LVDS part3 */
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#define IMX8QXP_MIPI0_DSI_PHY_DIV 499
#define IMX8QXP_MIPI0_DSI_PHY_CLK 500
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#define IMX8QXP_MIPI1_DSI_TX_ESC_SEL 505
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#define IMX8QXP_MIPI1_DSI_PHY_SEL 507
#define IMX8QXP_MIPI1_DSI_PHY_DIV 508
#define IMX8QXP_MIPI1_DSI_PHY_CLK 509
/* DC part3 */
#define IMX8QXP_DC0_DPR1_APB_CLK 510
#define IMX8QXP_DC0_DPR1_B_CLK 511
#define IMX8QXP_CONN_PLL0_CLK 512
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#define IMX8QXP_SDHC2_SEL 516
/* PARALLER CSI */
#define IMX8QXP_PARALLEL_CSI_CLK_DPLL 517
#define IMX8QXP_PARALLEL_CSI_CLK_SEL 518
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#define IMX8QXP_MIPI0_PWM_DIV 524
#define IMX8QXP_MIPI1_PWM_DIV 525
#define IMX8QXP_MIPI0_PWM_CLK 526
#define IMX8QXP_MIPI1_PWM_CLK 527
#define IMX8QXP_LSIO_MU5A_IPG_S_CLK 528
#define IMX8QXP_LSIO_MU5A_IPG_CLK 529
#define IMX8QXP_CLK_END 530
#endif /* __DT_BINDINGS_CLOCK_IMX8QXP_H */
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